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JPEG2000 EBCOT编码器的VLSI结构设计

北京航空航天大学 辅仁网/2017-07-06

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文献详情


JPEG2000 EBCOT编码器的VLSI结构设计
外文标题VLSI Architecture of EBCOT Encoder for JPEG2000
文献类型期刊
作者刘雷波[1];李德建[2];孟鸿鹰[3];张利[4];王志华[5];陈弘毅[6];夏宇闻[7]
机构
来源信息年:2003卷:26期:4页码范围:61-65
期刊信息北京邮电大学学报ISSN:1007-5321
关键词优化截断的嵌入式分块编码;动态内存控制;JPEG2000
摘要采用并行运算和动态内存控制DMC(dynamic memory control)的结构完成了EBCOT(embedded block coding with optimized truncation)编码器的VLSI设计.在保证编码速度的前提下,最大限度降低了片内存储器的访问频率,同时将片内小波系数缓存量减少了60%以上.在200 MHz的工作主频下,每秒可以完成20帧分辨率为1 024×1 024×24比特图像的JPEG2000编码.该EBCOT编码器已经作为单独的IP核应用于目前正在开发的JPEG2000图像编解码芯片中.
收录情况PKUISTIC
所属部门电子信息工程学院
链接地址http://d.g.wanfangdata.com.cn/Periodical_bjyddx200304013.aspx
DOI10.3969/j.issn.1007-5321.2003.04.013


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影响因子:


暂无成果共有人
dc:title:JPEG2000 EBCOT编码器的VLSI结构设计
dc:creator:刘雷波;李德建;孟鸿鹰,等
dc:date: publishDate:2003-12-20
dc:type:期刊
dc:format: Media:北京邮电大学学报
dc:identifier: LnterrelatedLiterature:北京邮电大学学报.2003,26(4),61-65.
dc:identifier:DOI:10.3969/j.issn.1007-5321.2003.04.013
dc: identifier:ISBN:1007-5321
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